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卡为实现８位ａ／ｄ和３２位ｐｃｉ总线的宽度匹配，采用了位扩展技术。为加深ｆｉｆｏ的缓冲深度，将外加ｆｉｆｏ缓存与ｐｃｉ接口芯片内部的ｆｉｆｏ相级连。 ２．４ 基于ｃｐｌｄ的控制逻辑 基于ｃｐｌｄ的控制逻辑是高速数据采集卡的核心，它为ｐｃｉ接口芯片提供满足时序要求的读写信号，同时选择模拟信号的输入通道、控制高压脉冲发生逻辑并设定放大电路的增益。此外，ｃｐｌｄ还能利用高速ｆｉｆｏ缓存的空、满标志位，配合ｐｃｉ接口芯片实现ｄｍａ写操作，完成高速数据传输。ｘｉｌｉｎｘ 公司的ｘｃ９５７２ｘｌ－ｖｑ６４xc9572xl-vq64芯片的脚到脚延迟最大为１０ｎｓ，可满足ｐｃｉ总线接口时序的要求。单片ｘｃ９５７２ｘｌ－ｖｑ６４能满足焊缝缺陷自动超声检测系统逻辑控制的要求，且具有体积小、可靠性高、调试方便等突出优点。 图２是基于有限状态机ｆｓｍ（ｆｉｎｉｔｅ ｓｔａｔｅ ｍａｃｈｉｎｅ）方法设计的控制逻辑状态转换图。其中，ｒｓｔ和ｉｒｑ是由ｐｃｉ接口芯片ｓ５９３３输出的可由程序任意控制的两个信号，它们的高低状态同高速ｆｉｆｏ缓存的空、满信号一起决定了控制逻辑的六个可能的状态，图中以椭圆表示。计算机上电时，控制逻辑处于ｒｓｔ＝
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